puces programmables d'IC

Détail rapide :

Contrôleur de transmissions synchrone multicanal (MUSYCC)

Description : 

Les CN8478, les CN8474A, les CN8472A, et les CN8471A sont les contrôleurs de transmission synchrones multicanaux avancés (MUSYCCs) ce format et deformat jusqu'à 256 (CN8478), 128 (CN8474A), 64 (CN8472A), ou 32 (CN8471A) canaux de HDLC dans un circuit intégré simple de CMOS. MUSYCC fonctionne à la couche 2 du modèle de référence de protocole de (OSI) d'Open Systems Interconnection. MUSYCC transport fournit une solution pour traiter des canaux de HDLC pour des applications d'interconnexion de réseaux telles que le relais de trame, une signalisation de D-canal du RNIS, de X.25, de système de signalisation 7 (SS7), de DXI, d'ISUP, et de LAN/WAN données complètes et à haute densité. Sous la surveillance minimale d'hôte, MUSYCC contrôle une liste chaînée des amortisseurs de données de canal dans la mémoire de centre serveur en exécutant accès mémoire direct (DMA) des canaux de HDLC.

MUSYCC se connecte par interface à huit trains de données de données périodiques indépendants, tels que T1/E1 signale, et puis transfère des données à travers l'autobus à 32 bits populaire de (PCI) d'interface de composant périphérique à la mémoire système à un taux de jusqu'à 66 mégahertz. Chaque interface série peut être actionné à jusqu'à 8,192 mégahertz. Des canaux logiques peuvent être tracés en tant que n'importe quelle combinaison des tranches de temps DS0 pour soutenir des hyperchannels du RNIS (Kbps Nx64) ou en tant qu'un certain nombre de peu dans un DS0 pour des applications subchanneling (Kbps Nx8).

MUSYCC inclut également un port à 32 bits d'expansion pour jeter un pont sur l'autobus de PCI aux microprocesseurs ou aux périphériques locaux. Un port de JTAG permet à l'essai de frontière-balayage de remplacer l'essai de panneau de lit-de-clous.

Les programmes pilotes de périphérique pour Linux, VxWorks®, et systèmes d'exploitation de pSOS™ sont disponibles aux termes d'un accord de licence de NO--honoraires de Conexant. Les programmes pilotes de périphérique incluent des documents de code source de C et de logiciel de soutien.

Applications :

• 256-, 128-, 64-, ou contrôleur de 32-channel HDLC

• Appui de protocole de la couche OSI 2

• Usage universel HDLC (OIN 3309)

– X.25 (LAPB)

– Relais de trame (LAPF/ANSI T1.618)

– D-canal du RNIS (LAPD/Q.921)

– Appui SS7

• interfaces série 8, 4, 2, ou 1 indépendants qui soutiennent

– Trains de données des données T1/E1

– C.C à 8,192 autobus de Mbps TDM

• Canaux logiques configurables

– DS0 standard (56, 64 Kbps)

– Hyperchannel (Nx64)

– Sous-canal (Nx8)

• sélection de mode de protocole de Par-canal

– mode de 16 bits de FCS

– mode à 32 bits de FCS

– Mode SS7 (FCS de 16 bits)

– Mode transparent (données non formatées)

• gestion d'amortisseur du Par-canal DMA

– Structures de données de liste chaînée

– Transmission/réception variable fifo de taille

• contrôle de longueur de message de Par-canal

– Ne choisissez aucune vérification de longueur

– Choisissez parmi deux registres 12-bit pour comparer la longueur de message

– Longueur maximale 16.384 octets

• Interface de bus directe de PCI

– opération de mégahertz à 32 bits, 66 ou 33

– Opération de maître et d'esclave d'autobus

– Version 2,1 de PCI

• Interface de bus locale d'expansion (EBUS)

– bus multiplexé à 32 bits d'adresse/données

– Accès d'éclat jusqu'à 64 octets

• Puissance faible, opération de 3.3/2.5 V CMOS

• Port d'accès de balayage de frontière de JTAG

• paquet de 208-pin PQFP/surface-mount

• BGA

Caractéristiques :

Avantage compétitif :

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